Tutorial de cadencia: Silicio las puertas lógicas (Iowa estado Universidad EE330 laboratorio 4) (5 / 6 paso)

Paso 5: Diseño de una puerta de lógica NAND entrada 3

La siguiente parte del laboratorio es un ejercicio de diseño. El lector a diseñar una puerta del NAND entrada tres independientemente.

1. diseño del esquema de

• Los tres NAND entrada tendrá tres transistores en serie. Con el fin de tener tiempos de subida y la caída igual el tamaño de 3 transistores en serie deben ser 3 veces mayores.
• Tamaño de los transistores correctamente es esencial para un correcto esquema.

2. diseño el diseño

• Explorar el uso de los dedos y los parámetros de multiplicador para crear combinaciones de transistor paralelo y serie
• Reducir al mínimo el área del diseño

3. Verifique la disposición

• Verificar pruebas de República Democrática del Congo y LVS

Entregables:

• Esquema
• Diseño
• Salida de éxito República Democrática del Congo
• Salida de LVS exitosa

Cada entregable debe ser adecuadamente documentado y presentado a la ayudante de enseñanza antes del informe de laboratorio fecha de vencimiento.

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